Verilog HDL Model SIM

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Verilog HDLModel SIM

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2
Agenda

• Verilog HDL
• ModelSim Student Edition
• ModelSim6.2 PE
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• ???

3
HDL?

• HDL (Hardware Description Language)
• VLSI ??? ??? ?? ? time-to-market ??
• GLM? schematic ?? ???
• HDL ??? ??? ??? ? ?? ?? ?? ???
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• Structural ? Functional ??? ?? ??
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• Concurrent language

4
HDL? ??

• Verilog HDL
• ????? verilog XL ???? ??
• C??? ??, 95? IEEE1364 ??
• VHDL
• ?? ???? ???? ??
• ???? ??? ??? ?? IEEE 1076??
• SFL
• ???? ? PARTHENON ?? HDL
• ?? ?? ??? ??? ??, ??
• ABEL-HDL
• DATA I/O??? ??, low level ??
• AHDL
• ALTERA?? ??, MAX ???? ???? ??
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5
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• FPGA/CPLD? ??? ??? ???? ??? ??
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6
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• FPGA/CPLD? ??? ??? ?? ??

7
ModelSim ??

• ModelSim PE Student Edition
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• http//model.com/content/modelsim-pe-student-editi
  on-hdl-simulation

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ModelSim ??
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9
ModelSim ??
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ModelSim ??
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ModelSim ??
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ModelSim ??
?? ModelSim? ??? ??? student_license.dat? ???? ??
14
Model Sim6.2 PE

• http//mpu.yonsei.ac.kr/lectures/2011_com/modelsim
  .zip

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16
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• Unzip modelsim.zip
• Make folder C\flexlm
• Execute keygen
• Rename license.txt to license.dat
• Copy license.dat file to flexlm folder
• Execute modelsim
• ??? ?? ?? ? ???? ?? ?? ??

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?? ?? ??(2)
V
V
18
Model-sim ??
c\Modeltech_6.2c\examples\tutorials\verilog\basic
Simulation
19
The End

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